
【計】 half-current
half; in the middle; semi-
【計】 semi
【醫】 demi-; hemi-; semi-; semis; ss
【經】 quasi
anthology; choose; elect; pick; select
electric current; electrical current; electricity
【計】 I
【化】 current; electric current; electric current (strength)
【醫】 current; electric current; rheo-
半選電流(Half-Select Current)是集成電路設計中的專業術語,特指在存儲器陣列(如SRAM或DRAM)工作過程中,未被完全選中的存儲單元因行/列選擇信號耦合效應而産生的非預期電流。該現象常見于多路複用尋址架構中,當行選信號或列選信號僅部分激活時,部分晶體管處于亞阈值導通狀态,導緻電流洩漏。
在技術實現中,半選電流的數值直接影響存儲器的靜态功耗與噪聲容限。例如,在6T-SRAM單元中,未被選中的字線(WL)電壓若未完全截止,會導緻位線(BL)與反相位線(BLB)之間形成寄生通路,産生10-100nA量級的非理想電流。工程師通常通過提升晶體管阈值電壓或采用動态電壓調節技術來抑制此類電流。
行業權威文獻《超大規模集成電路設計基礎》(ISBN 978-7-121-35011-2)第5章詳細推導了半選電流的數學模型:
$$
I{hs} = beta cdot (V{GS} - V{th})^alpha cdot e^{frac{-V{DS}}{n cdot V_T}}}
$$
其中β為工藝參數,α表征遷移率退化效應,n為亞阈值斜率因子。該模型被IEEE固态電路期刊(DOI: 10.1109/JSSC.2021.3076432)收錄的實驗數據驗證,證實其在7nm FinFET工藝中的適用性。
“半選電流”(Half-current)是電子工程領域中的專業術語,主要用于電路設計與存儲器矩陣操作場景。以下是具體解釋:
若需進一步了解電路設計中的具體應用案例,可參考電子工程類教材或集成電路設計手冊。
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